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Enclustra / ip

Stream Buffer Controller

流緩衝控制 IP

適用於高速資料流的緩衝管理 IP 核。

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Stream Buffer Controller通訊 IP 核Enclustra
FPGA
流緩衝控制 IP
Memory
—
Temp
—
Size
IP 核
產品概要

產品概要

Stream Buffer Controller 是 Enclustra 提供的適用於高速資料流的緩衝管理 IP 核。在 FPGA 內完成資料的暫存與流量控制，可構建高吞吐的資料通路。

Positive ONE Group 就 Stream Buffer Controller 提供一站式支援：選型諮詢、評估版提供、參考設計的獲取協助，以及量產階段的供貨與長期對應。我們以英語和日語進行作業。

示意圖

外觀與內部結構

CONCEPTUAL BLOCK DIAGRAM — Stream Buffer ControllerInputIFCoreLogicBufferFIFOOutputIFFPGA FABRIC (VHDL IP)
內部框圖（本公司製作）
SYSTEM CONNECTION — Stream Buffer Controller使用者邏輯Your logicStream Buffer ControllerIP CoreEthernetNetworkAXIMAC
系統連線示意
IP 規格

主要規格

Stream Buffer Controller 主要規格
支援的標準—（流緩衝 IP）
支援的 FPGA 系列AMD（Xilinx） / Altera（Intel）
速率取決於配置
埠配置—（緩衝控制）
工作模式高吞吐的流緩衝管理
時延與轉發方式DMA 與緩衝
介面AXI4 / AXI4-Stream
授權專案授權
交付物RTL、示例設計與文件
EDA 整合Vivado IP Integrator

實際的資源佔用（LUT/FF/BRAM）、支援的器件與速度等級隨配置而異。請告知您的需求，我們會在報價時給出具體數值。

介面與用途

主要介面與用途

主要介面

  • AXI / AXI-Stream（FPGA 內部互聯）
  • 標準 FPGA 匯流排介面

典型用途

  • 將功能模組整合到自有 FPGA 設計中
  • 縮短開發工時與驗證週期
  • 訊號處理、通訊與控制流水線的實現
FAQ

常見問題

該 IP 核以何種形式提供？

按專案授權提供。備有評估版，可在量產前於貴公司的 FPGA 上驗證執行。交付物為網表或加密 RTL、示例設計與使用者手冊。

Stream Buffer Controller 可以用在哪些 FPGA 上？

支援的 FPGA 為 AMD（Xilinx） / Altera（Intel）。廠商透過產品編號選擇。原廠公布的對象元件為 AMD 7-Series / Intel Arria 10 / Intel Cyclone V / Intel Cyclone 10。支援的開發工具為 AMD ISE / AMD Vivado / Altera Quartus。若目標元件已確定，請與我們確認可行性。

Stream Buffer Controller 的交付形式與授權方式是什麼？

以 VHDL 原始碼 IP 核形式提供，並附帶技術支援包。可透過豐富的綜合期與執行期引數最佳化 FPGA 資源佔用，也可根據用途進行定製開發。

如何評估 Stream Buffer Controller？

可申請為期三個月的評估授權。如需討論配置，請與我們聯絡。

Stream Buffer Controller 的價格和交期如何？

Stream Buffer Controller 的價格隨配置、授權方式、數量及定製內容而變動，因此採用單獨報價。請在本頁的諮詢表單中填寫用途與數量，我們的工程師會確認規格後回覆報價與交期。

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諮詢 Stream Buffer Controller

Stream Buffer Controller 由瑞士 Enclustra 的日本加值經銷商（VAR）Positive ONE Group 經銷。可否購買、數量與價格將向廠商確認最新供貨情況後答覆。

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價格隨配置與數量變動，因此本網站不公佈價格與庫存。索取單獨報價

執行環境

支援的 FPGA
AMD（Xilinx） / Altera（Intel）
支援的元件
AMD 7-Series / Intel Arria 10 / Intel Cyclone V / Intel Cyclone 10
開發工具
AMD ISE / AMD Vivado / Altera Quartus
評估
三個月評估授權（申請制）
授權
站點授權（半徑5km內的單一地點）