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SMVsubscriber — SMV処理 IP

FPGA向け VHDL IP

スマートグリッド向けSampled Measured Values(IEC 61850-9-2)のHW処理IP。

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SMVsubscriber — SMV処理 IP通信 IP コアSoC-e
FPGA
FPGA向け VHDL IP
Memory
—
Temp
—
Size
VHDL IP
製品概要

製品概要

現行の提供可否とライセンス条件は、ご検討時点でメーカーへ確認のうえご回答します。

図解

外観・内部構成

CONCEPTUAL BLOCK DIAGRAM — SMVsubscriber — SMV処理 IPParserFrameAES-GMACCipherKeyMgmtOutputSecuredFPGA FABRIC (VHDL IP)
概念ブロック図（当社作成の参考図。メーカー内部資料ではありません）
SYSTEM CONNECTION — SMVsubscriber — SMV処理 IPユーザ回路Your logicSMVsubscriberIP CoreEthernetNetworkAXIMAC
システム接続イメージ
IP仕様

主要スペック

現行の提供可否とライセンス条件は、ご検討時点でメーカーへ確認のうえご回答します。

SMVsubscriber — SMV処理 IP 主要スペック
対応規格IEC 61850-9-2 (Sampled Values)
対応FPGAファミリAMD（Xilinx）
速度—（SV処理IP）
ポート構成SVストリーム購読
動作モードSampled Values サブスクライバ
遅延・処理方式決定性のSV復号
インターフェースAXI4-Stream / AXI4-Lite, GMII
ライセンスプロジェクトライセンス / 評価版あり（現行条件は要確認）
納品物ネットリスト or 暗号化RTL, サンプルデザイン, ユーザマニュアル（現行条件は要確認）
EDA統合Vivado IP Integrator

実際のリソース使用量（LUT/FF/BRAM）、対応デバイス、速度グレードは構成により異なります。ご要件をお知らせいただければ、見積時に具体的な数値をご提示します。

インターフェース・用途

主要インターフェースと用途

主要インターフェース

  • Ethernet MAC/PHYインターフェース
  • AXI（FPGA内部接続）

想定用途

  • 変電所通信のサイバーセキュリティ（IEC 62351）
  • スマートグリッドの計測値保護
  • 重要インフラのリアルタイム通信暗号化
FAQ

よくある質問

このIPコアはどのように提供されますか？

ライセンス形態、評価手段、納品形式、供給条件は、ご検討時点でメーカーへ確認のうえご案内します。

SMVsubscriber — SMV処理 IPはどのFPGAで使えますか？

ライセンス形態、評価手段、納品形式、供給条件は、ご検討時点でメーカーへ確認のうえご案内します。

SMVsubscriber — SMV処理 IPの提供形態とライセンスは？

ライセンス形態、評価手段、納品形式、供給条件は、ご検討時点でメーカーへ確認のうえご案内します。

SMVsubscriber — SMV処理 IPを評価する方法はありますか？

ライセンス形態、評価手段、納品形式、供給条件は、ご検討時点でメーカーへ確認のうえご案内します。

SMVsubscriber — SMV処理 IPの価格・納期を知りたいのですが。

ライセンス形態、評価手段、納品形式、供給条件は、ご検討時点でメーカーへ確認のうえご案内します。

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動作環境

対応FPGA
AMD（Xilinx）
開発ツール
AMD Vivado
評価
暗号化・時間制限版あり（入手条件は要相談）
評価用ハードウェア
SMARTzynq Brick
SMARTmpsoc Brick
MEZU-A7G8 Brick